下面是通过case语句实现四选一电路部分程序，将横线上的语句补上，使程序形成完整功能。 
正确答案:
case（{s1，s0}）
2’b00：out=i0；
2’b01：out=i1；
2’b10：out=i2；
2’b11:out=i3;
2’b00：out=i0；
2’b01：out=i1；
2’b10：out=i2；
2’b11:out=i3;
答案解析:有
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verilog
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下面是通过case语句实现四选一电路部分程序，将横线上的语句补上，使程序形成完整功能。
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